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位后高端空出的位用符号位（*31位）来填充，即负数移位时用1来填充，正数移位时用0来填充。较后移出的位装入状态字中的CC1位。移位位数number的允许值为0～32。移位位数也可以放在累加器2的较低字节中，允许值为0～255，这时SSD指令不带移位位数number。移位位数>32时，移位后累加器1所有的位和CC1取符号位的值。
（3）16位字移位指令　16位字左移指令SLW<number >（Shift Left Word）将累加器1低字中的内容逐位左移，移位后低端空出来的位用0来填充，较后移出的位装入状态字中的CC1位。
16位字右移指令SRW<number >（Shift Right Word）将累加器1低字中的内容逐位右移，移位后高端空出的位用0来填充，较后移出的位装入状态字中的CC1位。
移位位数可以用指令中的<number>来设置，设置的方法与SSI指令的相同。符号位（*15位）来填充，即负数移位时用1来填充，正数移位时用0来填充。较后移出的位装入状态字中的CCI位。
下面的有符号数右移指令用指令中的<number>来*移位位数的上升沿，脉冲定时器开始定时，输Q4.0变为1。定时器的当前时间值等于TV端输入的预置值（即初值）减去启动后的时间值。定时时间到时，当前时间值变为0。Q输出变为0状态。在定时期间，如果I0.0的常开触点断开，则停止定时，当前时间值变为0，Q4.0的线圈断电。的t是定时器的预置值。
R是复位输入端，在定时器输出为1时，如果复位输入I0.1由0变为1，定时器被复位，复位后输出Q4.0变为0状态，当前时间值和时标被清0。
BI输出端输出不带时基的十六进整数格写错误响应程序，以处理这种同步编程错误。
（3）整数转换为BCD码　T双整数与浮点数之间的转换
①双整数转换为浮点数　DTR指令将累加器1中的32位双整数转换为32位IEEE浮点数（实数），结果仍在累加器1中。因为32位双整数的精双整数取反指令INVD将累加器1中的双整数逐位取反，结果仍在累加器1中。0.6为1，MD2中的双整数除以MD6中的双整数，运算结果传送到MD10。如果运算未能成功地完成，则状态字的OV和OS位为1，且使浮点数（实数）数学运算指令对累加器1和累加器2中的32位IEEE格式的浮点数进行运算，运算结果在累加器1中，在双累加器的CPU中，浮点数数学运算不会改变累加器2的值，对于有4个累加器的CPU，累加器3的内容复制到累加器2，累加器4的内容传送到累加器3，累加器4原有的内容保持不变。ENO为0，Q4.1为1状态；若运算成功地完成，则状态字的OV被清0，OS位保持原状态不变，且使RLO为1。下
整数求补指令NEGI将累加器1低字中的整数取反后再加1，运算结果仍在累加器1的低字中，求补码相当于一个数的相反数，即将该数乘以-1。
双整数求补指令NEGD将累加器1中的双整数取反后再加1，运算结果仍在累加器1中。
浮点数取反指令NEGR将累加器1中的浮点数的符号位（*31位）取反，运算结果仍在累加器1中。下面的例子将MD20中的双整数求补后传送到MD30度比浮点数的高，指令将转换四舍五入。
②浮点数转换为整数　RND（Round）指令将累加器1中的IEEE浮点

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